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    시높시스, 2나노 칩렛 표준 'UCIe' 설계 작업 완료…생산 이관

    시높시스가 2나노미터(㎚) 공정에 칩렛 표준을 적용하는데 성공했다. 서로 다른 반도체를 연결, 성능을 극대화하는 기술이 최첨단 공정까지 확대되고 있다. 반도체 설계자동화(EDA) 및 설계자산(IP) 기업 시높시스는 최근 2㎚ 공정 기술로 64Gbps UCIe IP를 테

    2026-04-09 10:12
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